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近計(ji)劃針對我(wo)們華(hua)清遠見(jian)的教學開發一(yi)套PXA270系(xi)統，我(wo)把我(wo)的一(yi)些軟、硬(ying)件開發過程(cheng)記錄下(xia)來和大家一(yi)起分(fen)享(xiang)、討論。有好的建議(yi)大家一(yi)定要及(ji)(ji)時(shi)(shi)交流，lht@farsight.com.cn。上一(yi)篇我(wo)寫(xie)了“PXA270嵌入式系(xi)統設計(ji)一(yi)：電源管理部分(fen)”，今天接著寫(xie)一(yi)下(xia)關于時(shi)(shi)鐘及(ji)(ji)復位(wei)部分(fen)的內容，歡迎(ying)指正(zheng)~~

一、時鐘部分

任(ren)何(he)一(yi)款處理(li)器都需要至少一(yi)個時(shi)鐘(zhong)源(yuan)。在處理(li)器的(de)內(nei)部會有相應(ying)的(de)時(shi)鐘(zhong)管理(li)單(dan)元來為(wei)cpu及(ji)各個功能控(kong)制單(dan)元提供合適的(de)時(shi)鐘(zhong)。

PXA270處理(li)器(qi)的需要兩個(ge)外部振(zhen)蕩器(qi)，1個(ge)13M和(he)1個(ge)32.768K。它(ta)們各(ge)自的作用：

• 13M的時鐘主要用于產生系統各個PLL的參考時鐘，也可以為部分低速控制器提供時鐘；
• 32.768K的時鐘主要用于為RTC控制器提供實時時鐘源，也可以為部分低速控制器提供時鐘。

PXA270處理器(qi)內部有兩(liang)個(ge)(ge)PLL單(dan)元(yuan)，一個(ge)(ge)是外圍PLL，另一個(ge)(ge)是核心PLL

• 外圍PLL使能后產生固定的312M時鐘，用于為高速控制器提供時鐘源；
• 核心PLL可以產生26—624M時鐘，用于cpu、內存控制器、系統總線、及LCD控制器。

時(shi)鐘(zhong)部分的電路原理圖：

二、復位部分

PXA270提供了5種復(fu)位(wei)方(fang)式：

• 上電復位：當VCC_BATT管腳第一次上電時產生，是一種完全復位。
• 硬件復位：也是種完全復位，當nRESET管腳置位時產生。
• 看門狗復位：看門狗控制器觸發，是一種部分復位，詳見PXA270芯片手冊。
• GPIO復位：是硬件復位的一種形式，可以由外部信號觸發。也是一種完全復位。
• 睡眠退出復位：復位那些在睡眠和深度睡眠時斷電的模塊。

系統中和復位相關的電路原理(li)圖。

• 上電復位

• 硬件復位

下(xia)圖是max1586C和系統復(fu)位電路相關的接線(xian)

K1為復(fu)(fu)(fu)位按鍵，通過max1586C的(de)(de)復(fu)(fu)(fu)位管理(li)(li)電(dian)路輸出nRSO信號。如(ru)果系統(tong)沒有類似max1586C的(de)(de)復(fu)(fu)(fu)位管理(li)(li)電(dian)路的(de)(de)話，可以用一(yi)片(pian)類似max811的(de)(de)復(fu)(fu)(fu)位芯(xin)片(pian)來(lai)完(wan)成，也可以用阻容及一(yi)些邏輯(ji)電(dian)路的(de)(de)方式來(lai)完(wan)成復(fu)(fu)(fu)位。

注意：max1586C的MR腳復位會復位max1586C的V3輸(shu)出到1.3V，對(dui)其它電(dian)壓(ya)輸(shu)出沒有影(ying)響。

下圖是復(fu)位(wei)信號和(he)PXA270的(de)nRESET的(de)接(jie)線。

當nRESET置(zhi)位或看門(men)狗(gou)控制器復(fu)(fu)位時，nRESET_O都可(ke)以置(zhi)位。可(ke)以用其來完成其它外圍芯片的復(fu)(fu)位。

下圖是JTAG電路(lu)，其復位信號要和系統的nRESET連接。

時鐘復位部分大致就這么多了。