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作為FPGA新人，對FPGA學習肯定會有很多問題，像FPGA是什么?FPGA怎么學?FGPA用什么語言之類的，前兩者我們專門發文章討論過，今天我們重點談一談FPGA用什么編程語言。

經常看到(dao)不(bu)少人在(zai)論壇里發(fa)問，FPGA是(shi)不(bu)是(shi)用(yong)(yong)C語(yu)言(yan)(yan)開(kai)(kai)發(fa)的(de)?國外有(you)些公司專注于開(kai)(kai)發(fa)解(jie)決編譯器這方面問題，目的(de)讓其(qi)能夠達到(dao)用(yong)(yong)C語(yu)言(yan)(yan)替代VHDL語(yu)言(yan)(yan)的(de)目的(de)，也(ye)開(kai)(kai)發(fa)出(chu)了(le)一些支(zhi)持用(yong)(yong)c語(yu)言(yan)(yan)對FPGA進(jin)行(xing)編程的(de)開(kai)(kai)發(fa)工具(ju)。但在(zai)使(shi)(shi)用(yong)(yong)多的(de)FPGA編程語(yu)言(yan)(yan)還是(shi)verilog和(he)VHDL語(yu)言(yan)(yan)，一般不(bu)使(shi)(shi)用(yong)(yong)C語(yu)言(yan)(yan)進(jin)行(xing)編程。

FPGA可以(yi)用(yong)(yong)(yong)VHDL語言和(he)VERILOG語言進行編(bian)程(cheng)開發(fa)，目前歐洲前者(zhe)(zhe)用(yong)(yong)(yong)的(de)(de)多，而，美國，日本則更多的(de)(de)使(shi)用(yong)(yong)(yong)后(hou)者(zhe)(zhe)，而且后(hou)者(zhe)(zhe)和(he)C語言比較的(de)(de)接近，如果你(ni)對C比較熟(shu)悉的(de)(de)話，可以(yi)選擇(ze)使(shi)用(yong)(yong)(yong)VerilogHDL語言，基本語法和(he)C非常(chang)相(xiang)似，而且也非常(chang)靈(ling)活，VHDL語言則相(xiang)對來說比較嚴謹(jin)。

其實兩種(zhong)語言(yan)(yan)的(de)差別并不大(da)，他們的(de)描述能力(li)也是(shi)(shi)(shi)類(lei)似的(de)。掌(zhang)(zhang)握(wo)其中一種(zhong)語言(yan)(yan)以(yi)后，可以(yi)通過短期(qi)的(de)學(xue)習，較快(kuai)的(de)學(xue)會另一種(zhong)語言(yan)(yan)。 選(xuan)(xuan)擇何(he)種(zhong)語言(yan)(yan)主要還是(shi)(shi)(shi)看周(zhou)圍人群的(de)使用(yong)習慣，這樣可以(yi)方便日后的(de)學(xue)習交流(liu)。當然(ran)，如果您是(shi)(shi)(shi)專用(yong)集成電路(ASIC)設(she)(she)計人員，則必須首先掌(zhang)(zhang)握(wo)verilog，因為(wei)在IC設(she)(she)計領域，90%以(yi)上的(de)公司(si)都(dou)是(shi)(shi)(shi)采用(yong)verilog進行IC設(she)(she)計。對于PLD/FPGA設(she)(she)計者而(er)言(yan)(yan)，兩種(zhong)語言(yan)(yan)可以(yi)自由選(xuan)(xuan)擇。

設計(ji)人員通過計(ji)算機對HDL語言進行邏輯(ji)仿真和邏輯(ji)綜合，方便高效地設計(ji)數字電路及其(qi)產品。

相對而言，歐洲(zhou)方(fang)面多(duo)用(yong)VHDL，特點是(shi)(shi)邏輯嚴謹、慎密。而verilog則是(shi)(shi)美(mei)國用(yong)的較多(duo)，特點是(shi)(shi)語(yu)法(fa)上(shang)更靈(ling)活一(yi)些。兩(liang)者在語(yu)法(fa)構成(cheng)方(fang)面都(dou)差別不大，一(yi)般都(dou)是(shi)(shi)通用(yong)的。VHDL編寫(xie)的程序可能(neng)看(kan)上(shang)去會(hui)臃腫一(yi)些但是(shi)(shi)對于后續的調試和修(xiu)改(gai)會(hui)更方(fang)便(bian)一(yi)些。

FPGA用什么(me)編程語言呢?verilog和VHDL，這(zhe)里(li)給(gei)初學者的建議是：從VHDL入手，進階兼顧Verlilog，相互對比著學習，更有利于程序的理解和編寫。